注意,这种功能仿真没有考虑电路实际的延迟,也无法获得精确的结果。
3.逻辑综合
确定设计描述正确后,可以使用逻辑综合工具(synthesizer)进行综合。综合过程中,需要选择适当的逻辑器件库(logic cell library),作为合成逻辑电路时的参考依据。硬件语言设计说明文件的制作风格是决定综合工具执行效率的重要因素。事实上,综合工具支持的HDL语法都是有限的,一些过于抽象的语法只适评价时的模拟模型,不能被综合工具接受。
5.布局和布线
布局指将设计好的功能模块合理地安排在芯片上,规划好它们的位置。布线是指完成各模块之间的连接。请注意,各模块之间的连接通常很长,所以延迟会严重影响SOC的性能,尤其是0.25以上的微米工艺。目前,这个行业还是中国的空缺,开设集成电路设计和集成系统专业的大学还很少,其中教师好的学校有上海交通大学、哈尔滨工业大学、哈尔滨理工大学、东南大学、西安电子科技大学、电子科技大学、复旦大学、华东师范大学等。该领域已逐渐饱和,越来越有走上当年软件行业的趋势。
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